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构建数字通信技术理论与实践之间的桥梁

孤云出岫去留一无所系 朗镜悬空静躁两不相干 菜根谭.明.洪应明

 
 
 

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《数字通信同步技术的MATLAB与FPGA实现_Altera/Verilog版》——勘误发布区  

2015-02-21 12:26:15|  分类: 通信同步技术 |  标签: |举报 |字号 订阅

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《数字通信同步技术的MATLAB与FPGA实现_Altera/Verilog版》——勘误发布区 - 杜勇 - 构建数字通信技术理论与实践之间的桥梁

请广大读者朋友将阅读本书发现的问题,以邮件发给我(duyongcn@sina.cn),或直接通过评论声明,我将在这里整理发布。感谢大家的支持!祝大家学习愉快!

第4章勘误情况:
1) p109: 式4-36后一段中:“因此环路滤波器的有效数据位数为鉴相乘法器输出的有效数据位数,为15“修改为
       "在后续代码设计时,为提高运算精度,将IIR滤波器增益增加了1024倍,即输出位宽增加了10比特。
       因此,环路滤波器输出有效数据位宽为25比特”。
      紧接下一段中“将fs,Tdds,Blp代入式(4-33)”修改为"将fs,Tdds,Blp代入式(4-36)"(2015.7.18)
      此勘误由“蓝笛的魔咒”发现,在此表示感谢!

2)P104:正确的计算是:

    《数字通信同步技术的MATLAB与FPGA实现_Altera/Verilog版》——勘误发布区 - cameion - 构建数字通信技术理论与实践之间的桥梁

      同时,书中(s/n)i<1dB,修改为,(s/n)i<0dB.


3)2016.3.10

        P113 “4-30”全部改为4-32;
        P115 第二行 "请读者对照式4-30"改为“4-32”;
        P117 “4-30”全部改为4-32;

       此勘误由xhtxyao@126.com”发现,在此表示感谢!

4)2016.3.26

     P104    444K rad/s*Wn <1767   444K   rad/s<Wn<1767
     此勘误由xhtxyao@126.com”发现,在此表示感谢!

第5章勘误情况:
    1)2016.3.2

    P150 滤波器代码倒数第二行,“+”改为“-”号吧。
    P166 信号取式(5-5)改为(5-24);
    P171 5.5.3下第三行,改为滤波器的“输出”信号改为
输入”信号;
    此勘误由xhtxyao@126.com”发现,在此表示感谢!


 第6章勘误情况:

1) P135:

liu_huan_xy@163.com
杜老师
您好!
我买了您的Altera/Verilog版的数字滤波器、同步技术和调制解调的一套书,目前正在仔细拜读中。
在您的《数字通信同步技术的MATLAB与FPGA实现-Altera/Verilog版》书中,第 135 页的最后一段,即式(5-6)的上 面,原文是 “本地VCO(或NCO)的同相与正交支路乘法器输出分别为” ,
但式(5-6)说的是VCO/NCO的输出,而非乘法器的输出,
所以,这里是不是应该修改为 “本地VCO(或NCO)的同相与正交支路输出分别为” 比较好。

回复:您的理解是对的。谢谢!

2)与xhtxyao的交流邮件

     杜老师:

      您好。
      您的同步技术的书,几乎每页都认真学习了,收益匪浅。
      第六章
     1、勘误:
       P197 addr>2改为>=2  因为只有在第一个点时的直流最大。
       P208 倒数第8行,根据式(6-35)改为(6-36);
       P209 6.5.2 “顶层模块......”标题向上倒数第三行,NCO的输入数据有效位宽为“32”改为“30”;
    2、疑问:

       P209增益K=230-1 ×fclk×Tclk ,有疑惑:

    按照P209讲解的“环路增益实际上就是NCO的输入电压幅值与频率字更新周期的乘积。”考虑到微分器增加了增益Tclk

    总增益是K=230-1 ×Tclk×Tclk,与书中的增益K=230-1 ×fclk×Tclk有所不同,请老师解惑。

   回复:

您好!
很高兴此书能够给你的学习带来帮助。也希望能够将此套图书推荐给更多的同学朋友。
根据你所提到的疑问,我查看了一下,问题出在式(6-36)。对于数字微分运算来讲,根据数学上的微分定义,应该是(y2- y1)/(t2-t1),所以式(6-36)应该改为fclk. d(Qt)/dt。
祝愉快!



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