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FFT与锁相环组合电路的捕获带宽及陷波器运算问题  

2016-01-20 22:56:26|  分类: 通信同步技术 |  标签: |举报 |字号 订阅

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 杜老师您好!
第一部分:
我在看您《数字通信同步技术的MATLAB与FPGA实现》VHDL这本书的时候,在FFT频偏估计这一章中,您提到可以在锁相环的前面加一个FFT频偏估计模块,并给出了对应于NCO的频率控制字和number的关系(第6章6.3节)。
我自己按照你书中的讲解,做了个仿真,将FFT模块和平方环构成一个整体,在FFT频率分辨率<(0.5*捕获带宽)的情况下,频偏较大时也能较快捕获。
问题来了,在讲锁相环的时候,对于一个环路的捕获带宽都是有计算公式的,确定了参数,就可以知道锁相环可以捕获中心频率左右多少带宽(HZ)范围内的载频;而对于FFT和锁相环组合的情况下,好像并没有一个计算公式来指明,组合情况下的带宽捕获范围?我猜测是(0,0.5*fs),但是具体是不是,还请老师有空能解答下。
第二部分:在《数字滤波器的MATLAB与FPGA实现》讲陷波器的时候,都是定义的系统时钟=数据速率*6;这样选是不是先因为,代码中计算需要用到6拍,然后才定义系统时钟=数据速率*6?如果计算用到6拍,我选择系统时钟=数据速率*8或者10倍,可不可以呢?
(书中的代码和光盘中不同,书中P272页,E_out为21bit,光盘中为35bit,应该是书中的印刷错误吧)


回复:

您好!

1)FFT与锁相环组合情况下的捕获带宽问题。首先,必须保证FFT估算后的频率误差在锁相环的捕获带内。在满足这个条件下,组合后的带宽就由FFT所能估计到的带宽了。0.5*fs就是其理论值,你可仿真试试。

2)感谢你指出的问题,该书有机会再版时将更正。系统时钟超过6倍的数据速率,当然是可以实现的。在设计时,只要满足一个数据采样周期内完成陷波算法中的各计算步骤即可。

祝愉快!

 

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